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Manual de VHDL: Síntesis lógica para PLDs (Ingeniería)
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Reseña del editor El lector tiene un libro que le enseñará de una forma práctica a utilizar el VHDL y a implementar estos diseños en CPLDs y FPGAs de la empresa Xilinx. El desarrollo del libro tie ne como hilo conductor a los ejercicios, cuyos planteamientos dan pie a un uso cada vez más potente del VHDL.Tapa blanda=236 páginas. Editor=Universidad de Deusto; Edición: 2 (15 de junio de 2006). Colección=Ingeniería. Idioma=Español. ISBN-10=8498300118. ISBN-13=978-8498300116. Valoración media de los clientes=Sé el primero en opinar sobre este producto.
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